http://www.isurs.com/ 多伦多商业、生活信息大全 :: XOOPS 中文论坛 Mon, 21 May 2012 07:49:51 -0000 http://backend.userland.com/rss/ CBB 4 欣家园论坛 admin@isurs.com admin@isurs.com zh-CN http://www.isurs.com/modules/newbb/images/xoopsbb_slogo.png http://www.isurs.com/ 92 52 http://www.isurs.com/modules/newbb/viewtopic.php?topic_id=4&forum= ::小生意也是生意，从头到尾都不可以轻心<br /> test3 Thu, 12 Feb 2009 02:02:16 -0000 http://www.isurs.com/modules/newbb/viewtopic.php?topic_id=4&forum= http://www.isurs.com/modules/newbb/viewtopic.php?topic_id=1019&forum=5 求职生涯::移民好项目寻求代理<br /> 澳大利亚加拿大绿卡持有者寻人商婚移民澳大利亚。有兴趣快速移民澳大利亚加拿大者，有兴趣快速通过商婚拿到澳大利亚加拿大永久居民绿卡者请发电邮至：<a href="mailto:wedvisa@126.com"><font color="#2f5fa1"><a href="mailto:wedvisa@126.com" title="wedvisa@126.com">wedvisa@126.com</a></font></a>（个人代理合作都可以）<br />请不要跟帖！请电邮联系，非诚勿扰。谢谢 Tue, 24 Jun 2008 01:00:26 -0000 http://www.isurs.com/modules/newbb/viewtopic.php?topic_id=1019&forum=5 http://www.isurs.com/modules/newbb/viewtopic.php?topic_id=963&forum=5 求职生涯::China Factory wholesale cheap:air jordans sneakers<br /> <p style="margin: 0cm 0cm 0pt" class="MsoNormal"><font size="3"><font face="Times New Roman"><span>&nbsp;</span><span>[img]<a href="http://www.wholesaleshoescn.com/UploadFiles/200831925046251.jpg"><a href="http://www.wholesaleshoescn.com/UploadFiles/200831925046251.jpg" title="http://www.wholesaleshoescn.com/UploadFiles/200831925046251.jpg" rel="external">http://www.wholesaleshoescn.com/UploadFiles/200831925046251.jpg</a></a>[/img]</span></font></font></p><p style="margin: 0cm 0cm 0pt" class="MsoNormal"><span><font face="Times New Roman" size="3">[img]</font><a href="http://www.wholesaleshoescn.com/UploadFiles/200831975310180.jpg"><font face="Times New Roman" size="3"><a href="http://www.wholesaleshoescn.com/UploadFiles/200831975310180.jpg" title="http://www.wholesaleshoescn.com/UploadFiles/200831975310180.jpg" rel="external">http://www.wholesaleshoescn.com/UploadFiles/200831975310180.jpg</a></font></a><font face="Times New Roman" size="3">[/img]</font></span></p><p style="margin: 0cm 0cm 0pt" class="MsoNormal"><span><font face="Times New Roman" size="3">Dear Sir or Madam:</font></span></p><p style="margin: 0cm 0cm 0pt" class="MsoNormal"><span><font size="3"><font face="Times New Roman"><span>&nbsp; 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http://www.isurs.com/modules/newbb/viewtopic.php?topic_id=957&forum=5 求职生涯::空前的困局，辉煌的明天 -张宏良 (zt)<br /> <p style="text-align: justify" class="a"><font style="font-size: 16px"><span style="font-family: 宋体"> 日渐迫近的奥运战争，将会把越来越多的世界目光，聚焦于天安门广场奥运会倒计时的巨大指针，除非是美国等西方国家主动放弃这一新型战争，否则没有任何外部 力量能够阻止他们发动这场新型战争。而要他们主动放弃这一历史机会只有一种情况，就是他们自己感觉到不仅无法打赢这场战争，甚至会带来无法估量的灾难性结 果。对美国等西方国家来说，无法估量的最大灾难，就是&ldquo;街头革命&rdquo;失败而导致毛派共产党人上台，这是美国民主基金会和美国中央情报局无论如何都不能接受的 结果，一旦形成这种结果，将是&ldquo;街头革命&rdquo;发动者对盎格鲁&middot;撒克逊人犯下的永远不可饶恕的最大罪行。盎格鲁&middot;撒克逊的那些金融寡头和少数政客十分清楚，一 旦毛派共产党人上台，别说肢解中国统治世界的计划会化为泡影，甚至连对本国的统治都难以维持，因为以大众经济大众政治为内容的新的世界变革正在动摇着寡头 统治的社会基础，此时如果毛派共产党人领导的中国成为新的世界政治文明的中心，寡头统治世界的时代将会彻底结束。</span>2<span style="font-family: 宋体">年 前我们在《当前中国左派和右派的斗争》中就曾经断言：&ldquo;无论西方国家在中国发动什么颜色的革命，最终都会演变成为一场红色革命&rdquo;，中国不同于苏联、东欧、 中亚等国家的最大特点，就是曾经有过文化大革命，有过全民参加的街头革命大演习，整个民族都受过街头革命的实战训练，特别是那些经过文革淬火的造反派，天 生就是街头革命的超级大师，甚至可以称得上是街头革命的老祖宗，和他们相比，美国那些散发着奶油味儿的所谓街头革命专家，不过是小巫见大巫，甚至连小巫都 算不上。以理性和谋略见长的盎格鲁&middot;撒克逊人绝不会忽略这一点，他们绝不会主动打开潘多拉盒子，释放出已被锁紧</span>30<span style="font-family: 宋体">年的毛派幽灵，<strong>他们可以接受任何一类中国政府，唯独不能接受一个毛派中国政府。这是他们所有对华政策不可突破的根本底线。</strong>所以，在避免毛派重新上台这个问题不能做到万无一失的情况下，他们会选择宁可暂时放弃&ldquo;街头革命&rdquo;或者说奥运战争的计划。</span></font></p> <p style="text-align: justify" class="a"><span style="font-family: 宋体"> <font style="font-size: 16px">从这个角度来说，届时美国等西方国家能否发动奥运战争，将完全取决于他们对中国左翼政治力量和爱国主义群众运动政治能量的判断，中美关系发展到今天，除了中国左翼政治力量和爱国主义群众运动的崛起之外，再也没有任何因素能够阻止他们对中国下手了。<strong>中国左翼政治力量和爱国主义群众运动，已成为美国动手肢解中国前唯一有所顾忌的政治因素，这也表明了中国左翼政治力量和爱国主义群众运动，正在成为推动中华民族崛起和东方文明复兴的新的民族复兴力量。</strong>如 果美国等西方国家坚信凭借其所操纵的各种国际反华势力，所控制的中国汉奸买办势力，所豢养的处于中国各个关键位置的美国鹦鹉，能够赢得未来北京&ldquo;街头革 命&rdquo;的胜利，他们就一定会毫不犹豫地发动奥运战争。届时，人类历史上最大规模的&ldquo;街头革命&rdquo;将在北京爆发，自称世界上最优秀的街头革命专家，将会与天生的 群众运动领袖展开生死大搏杀。无论期间中国人民会付出多大代价，最终都将一定会赢得这场奥运战争的伟大胜利，完成凤凰涅槃的历史升华，在世界东方再次升起 一个干干净净的崭新中国，以更加广泛的民主，更加健康的生活方式，更加干净的人文环境，重建世界政治文明，和各国人民一道，把世界纳入符合天道天理天良的 和谐发展轨道，彻底废除支配世界数百年的兽性发展规则，让人性的太阳照耀世界每一个地方。</font></span></p> <p style="text-align: justify" class="a"><span style="font-family: 宋体"> <font style="font-size: 16px">不过，就目前来讲，我们的敌人比我们更加自信，敌人的自信，主要来自于他们相信能够动用 中国的国家力量对付中国的爱国力量。目前法国驻中国大使就威胁要动用法律手段对付抵制家乐福的行为。法国大使的威胁让中国所有爱国者都脊背发凉。要知道， 这不是企业竞争，而是两国交恶，是两国之间的新型战争，两国交恶的一方居然自信能够用对方国家的司法力量来惩罚对方国民的爱国行为，这不能不说是该国国民 最大的悲哀，也是世界上很少国家的国民能够体会到的悲哀。<strong>他今天自信能够用对方国家的司法力量来惩罚其爱国的国民，明天就会更加自信地用对方国家的军事力量来惩罚其爱国的国民。如此的嚣张傲慢，甚至超过了八年抗战期间的日本大使，</strong>可 是我们又不得不感叹对方有理由嚣张傲慢，为这位法国大使鼓掌喝彩的，就是中国百家媒体百位名人对抵制家乐福的齐声讨伐。其实，中国老百姓抵制家乐福，不过 是如同受害妇女紧了一下裤腰带，就这么一个纯粹是弱者本能的下意识保护动作，就被中国百家媒体百位名人骂作是德日意法西斯民族主义。真想请教一下中国这百 家媒体百位名人，中国人到底要怎样做才不算是法西斯民族主义？外国人外国公司在中国享有的种种特权，在全世界都绝无仅有，外资几乎吸干了中国所有资源，致 使中国再也找不到一条干净的河流，再也找不到一口可饮用的水井，至少有数百万中国妇女的裤腰带可以任凭外国人随便解开，落到如此悲惨地步的苦难祖国，竟然 还要被她所养育的子孙骂作是法西斯民族主义，你们还有没有做人的最基本的天良！</font></span></p> <p style="text-align: justify" class="a"><span style="font-family: 宋体"> <font style="font-size: 16px">就拿眼前的家乐福超市来说，中国人应该做的不是什么抵制问题，而是应该收归国有。法国总 统萨克齐在竞选时就一再承诺，一定要让大型超市牢牢控制在法国人手里，把大型超市看作是法国第一战略产业。大型超市可以通过对生产和消费的两头定价，随心 所欲地掠夺所在国的社会财富，低价掠夺生产企业，高价掠夺消费者。<strong>中国去年以来愈演愈烈的通货膨胀，就是来源于大型超市的涨价狂潮。由于外资已经在中国大型超市中形成了绝对垄断地位，通货膨胀便成为外资大肆掠夺中国财富的公开合法手段。</strong>如 果情况倒过来，是中国公司垄断了法国超市，法国大革命肯定会再次爆发。超市已经成为外资插在中国身上的巨大财富吸管，而这个吸管的发动机就是通货膨胀。可 以说，一个超市，一个银行，已经成为西方国家控制中国经济主权的两大战略产业，目前西方国家之所以对中国如此肆无忌惮，就是因为他们已经完全控制了中国超 市，并且正在控制中国银行。每一个遭受通货膨胀之苦的中国人都要记住，你们的微薄收入是被家乐福等外资超市抢走的，他们掏空了你们的钱包，又指使美国鹦鹉 说什么通货膨胀是流动性过剩的结果，要解决流动性过剩，就必须改革银行，把银行也交给对方。如此高明的连环杀招，用《地道战》中伪军大队长那句话来说，就 是&ldquo;高，实在是高&rdquo;，只是这种高明是通过中国的买办汉奸来实现的。所以，无论中国百家媒体百位名人主观动机怎样，在客观上都是地地道道的汉奸勾当。大家可 以想一下，为什么同样是抵制，法国从政客、议员到百姓都动员起来抵制中国奥运，却没有法国百家媒体百位名人出来指责法国是法西斯民族主义；而中国人抵制家 乐福，马上就有中国百家媒体百位名人出来指责中国人是法西斯民族主义<strong>？同样是国家精英在同样事件上同样是对待祖国，为什么会有如此截然相反的不同反映？</strong>你只要去比较一下法国大革命和文化大革命的不同区别，比较一下二战后法国人对待法奸和中国人对待汉奸的不同区别，自然就会找到其中的答案。</font></span></p> <p style="text-align: justify" class="a"><span style="font-family: 宋体"> <font style="font-size: 16px">大潮将至，所有政治力量和各色人物都会蠢蠢欲动，浮出表面，以保证历史的筛选无一遗漏； 大潮之下，所有政治力量和各色人物都会显露出本来面目，以保证中华民族能够清洗得干干净净，又不至于清洗错误；大潮过后，冲走的只是肮脏的泡沫，留下来的 所有东西包括每一颗最细小的石头，都是干干净净的沙粒。</font></span></p> <p style="text-align: justify" class="a"><font style="font-size: 16px"><span style="font-family: 宋体"> 还剩</span>3<span style="font-family: 宋体">个多月，那帮浑身散发着刺鼻狐臭味、双手沾满历史血腥的家伙就要降落北京，肆意享受</span>13<span style="font-family: 宋体">亿中国人民历时数年吐血准备的历史上最为丰盛的奥运大餐。如果对方吃完拍屁股走人，咱也就洗筷子刷碗，祛除满屋的狐臭腥味，然后再找刘明康看看咱家的&ldquo;房契&rdquo;有没有被人乘机顺走；如果对方吃完掀桌子扒房，那就正好做一个百年了断。</span></font></p> <p style="text-align: justify" class="a"><font style="font-size: 16px"><span style="font-family: 宋体"> 中国与西方的百年恩怨，也该做一个历史了断了。</span></font></p> Sat, 19 Apr 2008 03:37:09 -0000 http://www.isurs.com/modules/newbb/viewtopic.php?topic_id=957&forum=5 http://www.isurs.com/modules/newbb/viewtopic.php?topic_id=837&forum=5 求职生涯::是加拿大公民，浅谈在美国做 IT的一点感受<br /> <p><font size="3">转贴：</font></p><p><font size="3">我是加拿大公民，浅谈在美国做 IT的一点感受 <br /><br /><br />阿君是在国内读完 MBA 后，技术移民过来的。 2000 年到加拿大改行学了电脑。去年从约克大学毕业，有几段美国电脑公司的工作经验。他计划再用一两年的时间在美国多取得一些工作经验，然后在多伦多找一个 FULL TIME 的电脑工，稳定下来。<br /><br />作为朋友接近阿君，觉得他是一个质朴、健谈、大而化之的人，而从提出要采访他和在采访的过程中，才发觉他身上那种学理科的人士所特有的严谨、审慎。没有丝毫的夸张不说，谈话从来不离题。省去了我从漫无边际的采访中归纳出一个主题所要动的脑筋。<br /><br />这个主题是从他自己的实情出发的，讲述的是一个有着北美教育背景的电脑本科生，如何开始在北美电脑公司工作；以他所体验到的工作中的种种细微之处，告诉后来者该注意什么，该如何适应。<br /><br />( 我是 2004 年 5 月从约克电脑专业毕业，之前和之后一直有通过网络做一些 PART TIME 的帮人写程序的工作。刚毕业，我尝试在多伦多找电脑工，但多伦多当时 JAVA 的工不好找，人也太多，就开始想找美国的工。 <br /><br />为什么想到要找美国工呢？一是因为美国的电脑工作机会多，另外我有一个优势是， 2004 年的时候，我既拿到了学位，又正好入籍。所以，我去美国，比较容易拿到工作签证，叫 TN VISA ，是专门针对加拿大公民，且有相关学位和相关工作经验的人。<br /><br />因为我喜欢加州，所以，目标就锁定在加州。去年 10 至 12 月份，我通过网络联系到加州一家电脑公司，面试完了，他们寄来 OFFER ，我自己拿着 OFFER 直接去 BUFFULOR （赌场旁边的那个城市）办了签证。今年 1 月，就去上班了，因为是短期 CONTRACTOR （合约工），所以在加州只工作了 3 个月。<br /><br />回来后，今年 5 月初，我去了弗罗里达，开始也是 CONTRACTOR ，但对方说有可能转 FULL TIME 。做了快 4 个月，感觉压力太大了，不想转 FULL TIME ，就退出了。这个公司的要求比较苛刻，给你的是 40 多个小时的工资，但工作量几乎是 50 多 60 个小时。我现在理解了，公司当初说可以转 FULL TIME 就是在暗示：超时工作是没有钱拿的。而第一份工完全是 CONTRACTOR ，在公司呆 8 小时就可以的。<br /><br />1 、不要问太多问题<br /><br />我工作的第一个公司是大公司，有 1000 多人，很规范，整个制度很好，人际礼仪是代表美国正统文化的那种。我去的时候，他们的 PROJECT 是比较新的，前一两天我就希望能尽快上手，有一些不太明白的地方，问了一些旁边的同事和 TEAM LEADER 。<br /><br />第三天中午跟一个越南华裔同事一起吃饭，他也是一个 CONTRACTOR 。他对我说了自己的亲身经历。以前他去一个新公司的时候，不到一周就被炒了，原因就是他问的问题太多了，让人觉得他不能胜任工作。我后来明白，他其实是在善意地暗示我，不要问太多问题。<br /><br />我回想了一下，第一天刚去的时候，大家对我都挺友好的，第二天，他们就没有什么话题了，我当时还没有留意到他们的反应，第三天我通过这个同事才知道原因所在。所以，有什么不懂的，就上网查资料，自己钻研，没有再向周围的人问过多的问题了。对一些真正要问的，我就事先发 E-MAIL 给 TEAM LEADER ，以免在上班的时候打扰他。<br /><br />事实上， CONTRACTOR 用一个形象的比喻，就好比是一个炸弹专家，要去突破一个个技术难关。人家是有紧急情况才请 CONTRACTOR 的，人工也 PAY 得很高，如果你表现出不胜任，想长期呆下去肯定就有危机。<br /><br />而且，你自己要警觉，从别人对你的态度也看得出一些问题。比如 TEAM LEADER 的话也突然变少了，也许他就是暗示我要少讲话了。<br /><br />2 、要有团队精神<br /><br />我工作的加州那家公司很大，总共有 5 个 TEAM ，每个厅大概只有一两个中国人，总共可能才七八个人。中午吃饭有一个小时时间，有时候就跟几个同胞在一起聊天。从他们那里，我知道，一两年前，公司的中国人还是比较多的，后来被一些其他亚裔如印度，越南，巴基斯坦的人顶替。之所以这样，他们暗示说是中国人的 TEAM 不怎么团结。比如，有的项目在规定的时间没有完成， TEAM LEADER 会问为什么没有完成，中国人就在 TEAM LEADER 面前说别人的技术不行，推委责任，而这又会反过来让 TEAM LEADER 觉得他本人只注重个人表现，不愿意跟同事分享你的技术。最后整体的感觉是，中国人的团队精神不够。而印巴人互相之间讨论很多，肯互相 SHARE 他们的 IDEA 和技术。所以，慢慢地，中国人很快就给替换掉了。<br /><br />我想我的中国同胞之所以这样对我说，也是在暗示我要有团队精神。他们之所以留下来，是有他们的生存方式的。<br /><br />所以，我觉得在电脑公司上班，所要考虑的不仅是技术，还有周围的人际关系。基本上，公司能够把 OFFER 给你，表示你在技术上已经过关了。但在具体的工作中，每个人都有不懂的时候，问题是你要如何应付它。通过朋友，通过同事解决问题的时候，也要考虑怎样可以不打扰人家或者令到人家对你没有意见，这都是自己要把握的分寸。<br /><br />3 、技巧地处理沟通问题<br /><br />在小公司里做，你的知识面要很广才能适应。要通盘考虑其他人的工作，产品从开始到最终交付给客人的整个过程都要很了解。最好是自己能把整套软件装到自己的电脑里去运行，懂得在电脑上如何测试整套产品。<br /><br />我在弗罗里达那家小公司做的时候，除了要开发，还要给客户解决很多问题，比如安装、调试以及维护等。通常不仅要知道问题在哪里，还要懂得解决问题的方式。对方如果对你们开发的软件不满意，还要懂得怎样去说服他；如果对方仍不满意，还要考虑怎样向自己的 TEAM LEADER 去报告问题。<br /><br />通常沟通的方式有电话， E-MAIL 和面谈。有可能三种方式都经常会用到。用电话沟通，不需面对对方，但你的听力就要很强，口语要强；面对面就要会从别人的语言、表情和肢体迅速领会别人的意思，并当面作出反馈。<br /><br />我发现这也是非常重要的。你代表的是一个公司，穿着、用语态度都不能马虎。我在美国电脑公司工作，穿着平时一般是便服、便鞋，便服一般是有衣领的，但不能穿牛仔裤，不过，在美国，周五大家都是穿牛仔裤和波鞋。<br /><br />刚开始，中国人常常会因为这些非技术的东西，会因为不会表达，令客户不满意，老板不满意，从而也很有危险感。我一开始也存在这样的问题。语言不好，就经常采取 E-MAIL 联系方式，比如，某段话听不懂，你不要直接对他说你听不懂，话可以婉转一点，让他把问题 E-MAIL 给你，然后在电子邮件中给他一些解答，这其实也是一种技巧。<br /><br />即使你的听力没有问题，对别人一些暗示的话语，你也要 &ldquo; 听 &rdquo; 得明白。如果人家说 &ldquo; I&rsquo;M BUSYING AND I DON&rsquo;T HAVE MUCH TIME NOW 。 &rdquo; 表层的意思，大家都懂，但深层意思，就是要你不要打搅他。你怎么反应，很重要。这边的礼仪其实并不完全像很多人以为的那样。他们有意见，的确是喜欢当面说，但他们也不会直接了当地说，会说得很隐讳，很有技巧，会让你听得很舒服。这也是他们的涵养。但你就要会听了。<br /><br />反过来，如果你直接向上面反应一些问题，他会觉得你不好，才会说别人不好的。你有问题要反应，也要很有技巧。<br /><br />其实，我觉得，在电脑这个以技术为主的行业里， COMMUNICATION 也要占到工作的 30% 左右，能力也要很强才行，不能不考虑。<br /><br />4 、巧借外力<br /><br />在第二个公司那里做一个 PROJECT 的时候， FRONT PAGE DESIGE 不是我的强项，而且当时那个 PROJECT 时间上又很紧，我后来就想到一个方法，通过网络交给别人去做。我觉得这也算得上是一个经验，很多这个行业地人可能都会有这个需要，也可能有很多人已经在这样做。<br /><br />在网上找别人帮忙写程序，当然是要付费的。不过，在有些时候，如果你做不了，可能整份工作都没有了。当然，这也看你的 PROJECT 能否分割，以及能否找得到人。我想到这一点，也是因为我以前在网上曾经这样帮人写过程序。所以，反过来推理，我也可以找人来帮我的忙。<br /><br />5 、当领导有专长<br /><br />我现在回想起来，我是喜欢大公司的。一个原因是，压力没有那么大，另一个，它的管理比较规范合理，不会把人逼得很厉害，整个素质礼仪也会好很多。而且，分工也很细，通常也是一个萝卜一个坑。<br /><br />在电脑行业来说，通常在大公司，要 LAY OFF 的话，一般是整个 TEAM 被 LAY OFF ，除非有特殊情况，才可能 LAY OFF 个别一两个人的。辞职是另当别论了。<br /><br />而我干过的那家小公司，我所在的 TEAM 一共才六个人，管理比较乱，文化也很不好。不仅经常要超时工作，而且，一个人要懂很多方面才行，要求很过分。所以，我一去就遇到很多困难，而他们的管理又非常严厉，感觉非常不好。但说实在的，这样的小公司在美国很多。<br /><br />我的感觉是一个 TEAM 里如果有一个印度人的话，很快就会把整个 TEAM 都换成印巴人的。而中国人通常没有这么强的能力。主要还是观念的差别。他们之间人与人之间相处的方式跟中国人完全不同。他可能不会想到我自己怎么生存，而是会考虑几个人绑在一起怎么生存，是以种自觉的考虑。而中国人可能是考虑自己怎么出人头地多一点。<br /><br />这也是文化的不同。中国人以为自己强了，就好了。这个想法单纯来说也没有错，但在具体做法上就会影响到别人。好比我们的上司，他永远想的是全体，不会认为某个人的表现有多好，无论你的表现多好，他也会认为那是应该的。当然，如果你的表现非常好，他也会给一个较高的职位给你。<br /><br />在这边做 TEAM LEADER ，除了要有语言优势，还要有文化背景上的优势。而中国人在这两方面都没有优势。所以，对有人说的，中国人在这边的电脑公司很少能达到领导层，是因为不会溜须拍马，我不认同。以我在美国电脑公司工作的经验，我没看出有拍马屁的现象。在我的眼里， TEAM LEADER 的确是有专长的。他真的要把整个 TEAM 渲染得很好。他既懂得向上面去推销整个 TEAM ，让上司觉得这个 TEAM 完全能够胜任工作，也知道怎么去分派工作。 </font></p> Wed, 09 Jan 2008 15:54:52 -0000 http://www.isurs.com/modules/newbb/viewtopic.php?topic_id=837&forum=5 http://www.isurs.com/modules/newbb/viewtopic.php?topic_id=646&forum=5 求职生涯::美国职场奋斗记 -yijibang<br /> <p><font size="3">感谢作者分享。</font></p><p><font size="3">不知道读者会不会跟我有一样的感觉。我真的是受益匪浅！</font></p><p><font size="3">我虽然只有十来年的工作经验-包括在中国三家公司，加拿大两家公司，但是很多感受跟yijibang老师是一样的。</font></p><p><font size="3">yijibang遇到的很多问题在那里都碰得到的，不管是中国，美国还是加拿大。</font></p><p>&nbsp;</p> Tue, 09 Oct 2007 17:46:52 -0000 http://www.isurs.com/modules/newbb/viewtopic.php?topic_id=646&forum=5 http://www.isurs.com/modules/newbb/viewtopic.php?topic_id=636&forum=5 求职生涯::e Freshers Interview Guide from dsprelated<br /> At Signalogic I&#39;m in hiring mode right now, looking for a couple of entry-level engineers. After several&nbsp;interviews over the last few&nbsp;weeks I find troubling patterns... things young engineers should know, but they don&#39;t. Things they put on their resume but shouldn&#39;t, things they say or do in the interview they should not, and things they fail to say or do. <p>Then I see questions for &quot;interview help&quot; on DSP and FPGA tech groups that miss the point, asking about how to do &quot;homework&quot; to prepare for an interview, what topics are &quot;must need to know&quot;.</p><p>Ok, time for a blog! Maybe I can help some freshers out a little. Or at least I can try.</p><p>1) First and foremost, please recognize that as a new BS/MS EE/CS grad or graduate student intern, the plain fact is you don&#39;t know much and you won&#39;t for a few years. That&#39;s just the way it is, no getting around it. Trying to study or &quot;cram&quot; before an interview is a waste of time. You can&#39;t go in as&nbsp;&quot;knowledgeable&quot;, or &nbsp;relying on &quot;credentials&quot; -- what classes you&#39;ve taken, what lab projects you did, what research assistantship you had, etc. Your objectives should be to go in ready to show you are a quick learner, organized, prepared to demonstrate your problem solving skills (hopefully you&#39;ve acquired those during your recent education!), and dedicated to a teamwork philosophy.</p><p>2a) Be sharp and quick. When you know something, explain it concisely (fewer words is better), and with confidence.</p><p>2b) When you don&#39;t know something, just say so, immediately. Don&#39;t ever, ever try to bolshevik (an abbreviation for a similar word which I presume is well-known). I have cut interviews short, on the spot, because the candidate tried to make something up. Making up even the smallest bogus detail stands out like a huge warning flag to a person with 20+ years of experience. For example, *do not* put acronyms on your resume if you don&#39;t know them cold. If you say you know about FPGAs, you should know what FPGA stands for. If you say you are familiar with SIP protocol, then you had better know what SIP means.</p><p>3) On the other hand, when asked a technical question you don&#39;t know all of, but you know part of, do not hesitate to try and figure it out. Make a sketch, draw a graph, try to interpolate from what you do know. Managers like to see you reason and try to solve a problem. They like to see how you think. The worst new engineer is the one who sits in the lab like a bump on a log when faced with a bug, with no ideas on how to get unstuck and go forward. Any opportunity you have to show creativity -- and willingness and happiness to plunge in and get muddy and figure out the problem -- will win you a lot of points.</p><p>4) Make your resume solid and based on what you truly know and have learned. If you put it on your resume, you had better know it. Many times I see something like &quot;Texas Instruments C6000 DSP project for this lab or that internship or that Professor...&quot;. Ok, sounds promising! I&#39;m interested. Then I ask: &quot;what was the exact TI DSP part? Was it floating-point or fixed-point? What development tools did you use? How did you get code into the processor to run?&quot; If the candidate cannot remember the device, and specific details about it, then I know he/she really didn&#39;t do much of a project. If you truly work closely with a chip, then the device datasheet and manual become your best buddies for a few weeks, and you never forget. A lame answer that finally squeaks out like &quot;well, I was part of a team, and I just handled the C code part, and I don&#39;t really know how that C code got into the DSP chip&quot; is not going to cut it.</p><p>And what about those resumes that list every communications protocol ever invented by mankind? Because they were covered 15 min each in class? That&#39;s ridiculous. If you list even one of those, be prepared for in-depth questions -- you had better know it.</p><p>5) Debug, debug, debug, documentation, documentation, documentation. Learn to like those words. You should talk about debug and documentation with as much respect and enthusiasm as you do for design. If you sound like you only want to design, and you&#39;re too good for debug and documentation, that&#39;s a job prospect kiss of death. Debug and figuring out what is wrong with your wonderful, elegant design -- and explaining it to others -- is 2/3 of your career, so you need to be prepared.</p><p>Often I ask a candidate &quot;tell me about your worst bug&quot;. If I don&#39;t get a real story, with some gory but triumphant details like &quot;I slept in the lab for 3 days&quot; or &quot;it turned out the vendor&#39;s datasheet had the polarity backwards&quot; or &quot;the JTAG cable had a loose connector&quot;, then again, I know you did not work on a real project, or didn&#39;t participate at an in-depth level.</p><p>6) Act like you&#39;re already at work. Take notes. Ask questions and clarify. For example, I like to ask the person to send me several things after the interview (this or that source code example, a writing example, a web link to something they mentioned, etc). The objective is to ask for maybe 4 to 7 things with enough detail that is more than the candidate can remember. If they sit there nodding &quot;ya sure&quot; and they don&#39;t write anything down, then how am I to expect they can handle a blizzard of work instructions in the morning, and not forget anything by evening? Obviously not! I don&#39;t want to be impressed by how many items you can remember in an interview, I want to be impressed by your attention to detail and your organizational skills.</p> Tue, 02 Oct 2007 22:07:24 -0000 http://www.isurs.com/modules/newbb/viewtopic.php?topic_id=636&forum=5 http://www.isurs.com/modules/newbb/viewtopic.php?topic_id=634&forum=5 求职生涯::FPGA & ASIC Synthesis interview questions<br /> <h3><font size="3">FPGA &amp; ASIC Synthesis interview questions</font></h3><p><br /><font size="3"><strong>1) What is minimum and maximum frequency of dcm in spartan-3 series fpga?</strong> <br /><br />Spartan series dcm&rsquo;s have a minimum frequency of 24 MHZ and a maximum of 248 <br /><br /><strong>2)Tell me some of constraints you used and their purpose during your design?</strong> <br /><br />There are lot of constraints and will vary for tool to tool ,I am listing some of Xilinx constraints <br />a) Translate on and Translate off: the Verilog code between Translate on and Translate off is ignored for synthesis. <br />b) CLOCK_SIGNAL: is a synthesis constraint. In the case where a clock signal goes through combinatorial logic before being connected to the clock input of a flip-flop, XST cannot identify what input pin or internal net is the real clock signal. This constraint allows you to define the clock net. <br />c) XOR_COLLAPSE: is synthesis constraint. It controls whether cascaded XORs should be collapsed into a single XOR. <br />For more constraints detailed description refer to constraint guide. <br /><br /><strong>3) Suppose for a piece of code equivalent gate count is 600 and for another code equivalent gate count is 50,000 will the size of bitmap change?in other words will size of bitmap change it gate count change?</strong> <br /><br />The size of bitmap is irrespective of resource utilization, it is always the same,for Spartan xc3s5000 it is 1.56MB and will never change. <br /><br /><strong>4) What are different types of FPGA programming modes?what are you currently using ?how to change from one to another?</strong> <br /><br />Before powering on the FPGA, configuration data is stored externally in a PROM or some other nonvolatile medium either on or off the board. After applying power, the configuration data is written to the FPGA using any of five different modes: Master Parallel, Slave Parallel, Master Serial, Slave Serial, and Boundary Scan (JTAG). The Master and Slave Parallel modes <br />Mode selecting pins can be set to select the mode, refer data sheet for further details. <br /><br /><strong>5) Tell me some of features of FPGA you are currently using?</strong> <br /><br />I am taking example of xc3s5000 to answering the question . <br /><br />Very low cost, high-performance logic solution for<br />high-volume, consumer-oriented applications<br />- Densities as high as 74,880 logic cells<br />- Up to 784 I/O pins<br />- 622 Mb/s data transfer rate per I/O<br />- 18 single-ended signal standards<br />- 6 differential I/O standards including LVDS, RSDS<br />- Termination by Digitally Controlled Impedance<br />- Signal swing ranging from 1.14V to 3.45V<br />- Double Data Rate (DDR) support<br />&bull; Logic resources<br />- Abundant logic cells with shift register capability<br />- Wide multiplexers<br />- Fast look-ahead carry logic<br />- Dedicated 18 x 18 multipliers<br />- Up to 1,872 Kbits of total block RAM<br />- Up to 520 Kbits of total distributed RAM<br />&bull; Digital Clock Manager (up to four DCMs)<br />- Clock skew elimination<br />&bull; Eight global clock lines and abundant routing<br /><br /><strong>6) What is gate count of your project?</strong> <br /><br />Well mine was 3.2 million, I don&rsquo;t know yours.! <br /><br /><strong>7) Can you list out some of synthesizable and non synthesizable constructs?</strong> <br /><br />not synthesizable-&gt;&gt;&gt;&gt;<br />initial <br />ignored for synthesis.<br />delays <br />ignored for synthesis.<br />events <br />not supported.<br />real <br />Real data type not supported.<br />time <br />Time data type not supported.<br />force and release <br />Force and release of data types not supported.<br />fork join <br />Use nonblocking assignments to get same effect.<br />user defined primitives <br />Only gate level primitives are supported.<br /><br />synthesizable constructs-&gt;&gt;<br />assign,for loop,Gate Level Primitives,repeat with constant value...<br /><br /><strong>8)Can you explain what struck at zero means?</strong> <br /><br />These stuck-at problems will appear in ASIC. Some times, the nodes will permanently tie to 1 or 0 because of some fault. To avoid that, we need to provide testability in RTL. If it is permanently 1 it is called stuck-at-1 If it is permanently 0 it is called stuck-at-0. <br /><br /><strong>9) Can you draw general structure of fpga?</strong> <br /><br /><img src="http://asic.co.in/Index_files/synthesis_files/fpga_struct.gif" alt="" width="400" height="400" align="absMiddle" /> <br /><br /><strong>10) Difference between FPGA and CPLD?</strong> <br /><br />FPGA:<br />a)SRAM based technology.<br />b)Segmented connection between elements.<br />c)Usually used for complex logic circuits.<br />d)Must be reprogrammed once the power is off.<br />e)Costly<br /><br />CPLD:<br />a)Flash or EPROM based technology.<br />b)Continuous connection between elements.<br />c)Usually used for simpler or moderately complex logic circuits.<br />d)Need not be reprogrammed once the power is off.<br />e)Cheaper <br /><br /><strong>11) What are dcm&#39;s?why they are used?</strong> <br /><br />Digital clock manager (DCM) is a fully digital control system that<br />uses feedback to maintain clock signal characteristics with a<br />high degree of precision despite normal variations in operating<br />temperature and voltage. <br />That is clock output of DCM is stable over wide range of temperature and voltage , and also skew associated with DCM is minimal and all phases of input clock can be obtained . The output of DCM coming form global buffer can handle more load. <br /><br /><strong>12) FPGA design flow?</strong> <br /><br /><img src="http://asic.co.in/Index_files/synthesis_files/fpga_designflow.gif" alt="" width="333" height="310" align="absMiddle" /> <br /><br />Also,Please refer to presentation section synthesis ppt on this site. <br /><br /><strong>13)what is slice,clb,lut?</strong><br /><br />I am taking example of xc3s500 to answer this question <br /><br />The Configurable Logic Blocks (CLBs) constitute the main logic resource for implementing synchronous as well as combinatorial circuits. <br />CLB are configurable logic blocks and can be configured to combo,ram or rom depending on coding style<br />CLB consist of 4 slices and each slice consist of two 4-input LUT (look up table) F-LUT and G-LUT.<br /><br /><strong>14) Can a clb configured as ram?</strong> <br /><br />YES.<br /><br />The memory assignment is a clocked behavioral assignment, Reads from the memory are asynchronous, And all the address lines are shared by the read and write statements. <br /><br /><strong>15)What is purpose of a constraint file what is its extension?</strong> <br /><br />The UCF file is an ASCII file specifying constraints on the logical design. You create this file and enter your constraints in the file with a text editor. You can also use the Xilinx Constraints Editor to create constraints within a UCF(extention) file. These constraints affect how the logical design is implemented in the target device. You can use the file to override constraints specified during design entry. <br /><br /><strong>16) What is FPGA you are currently using and some of main reasons for choosing it?</strong> <br /><br /><strong>17) Draw a rough diagram of how clock is routed through out FPGA?</strong> <br /><br /><img src="http://asic.co.in/Index_files/synthesis_files/fpga_clk.gif" alt="" width="555" height="500" align="absMiddle" /> <br /><br /><strong>18) How many global buffers are there in your current fpga,what is their significance?</strong> <br /><br />There are 8 of them in xc3s5000 <br />An external clock source enters the FPGA using a Global Clock Input Buffer (IBUFG), which directly accesses the global clock network or an Input Buffer (IBUF). Clock signals within the FPGA drive a global clock net using a Global Clock Multiplexer Buffer (BUFGMUX). The global clock net connects directly to the CLKIN input. <br /><br /><strong>19) What is frequency of operation and equivalent gate count of u r project?</strong> <br /><br /><strong>20)Tell me some of timing constraints you have used?</strong> <br /><br /><strong>21)Why is map-timing option used?</strong> <br /><br />Timing-driven packing and placement is recommended to improve design performance, timing, and packing for highly utilized designs.<br /><br /><strong>22)What are different types of timing verifications?</strong> <br /><br />Dynamic timing:<br />a. The design is simulated in full timing mode.<br />b. Not all possibilities tested as it is dependent on the input test vectors.<br />c. Simulations in full timing mode are slow and require a lot of memory.<br />d. Best method to check asynchronous interfaces or interfaces between different timing domains.<br />Static timing:<br />a. The delays over all paths are added up.<br />b. All possibilities, including false paths, verified without the need for test vectors.<br />c. Much faster than simulations, hours as opposed to days.<br />d. Not good with asynchronous interfaces or interfaces between different timing domains.<br /><br /><strong>23) Compare PLL &amp; DLL ?</strong> <br /><br />PLL:<br />PLLs have disadvantages that make their use in high-speed designs problematic, particularly when both high performance and high reliability are required. <br />The PLL voltage-controlled oscillator (VCO) is the greatest source of problems. Variations in temperature, supply voltage, and manufacturing process affect the stability and operating performance of PLLs.<br /><br />DLLs, however, are immune to these problems. A DLL in its simplest form inserts a variable delay line between the external clock and the internal clock. The clock tree distributes the clock to all registers and then back to the feedback pin of the DLL.<br />The control circuit of the DLL adjusts the delays so that the rising edges of the feedback clock align with the input clock. Once the edges of the clocks are aligned, the DLL is locked, and both the input buffer delay and the clock skew are reduced to zero.<br />Advantages:<br />&middot; precision<br />&middot; stability<br />&middot; power management<br />&middot; noise sensitivity<br />&middot; jitter performance.<br /><br /><br /><strong>24) Given two ASICs. one has setup violation and the other has hold violation. how can they be made to work together without modifying the design?</strong><br /><br />Slow the clock down on the one with setup violations..<br />And add redundant logic in the path where you have hold violations.<br /><br /><strong>25)Suggest some ways to increase clock frequency?</strong><br /><br />&middot; Check critical path and optimize it.<br />&middot; Add more timing constraints (over constrain).<br />&middot; pipeline the architecture to the max possible extent keeping in mind latency req&#39;s. <br /><br /><strong>26)What is the purpose of DRC?</strong> <br /><br />DRC is used to check whether the particular schematic and corresponding layout(especially the mask sets involved) cater to a pre-defined rule set depending on the technology used to design. They are parameters set aside by the concerned semiconductor manufacturer with respect to how the masks should be placed , connected , routed keeping in mind that variations in the fab process does not effect normal functionality. It usually denotes the minimum allowable configuration. <br /><br /><strong>27)What is LVs and why do we do that. What is the difference between LVS and DRC?</strong> <br /><br />The layout must be drawn according to certain strict design rules. DRC helps in layout of the designs by checking if the layout is abide by those rules.<br />After the layout is complete we extract the netlist. LVS compares the netlist extracted from the layout with the schematic to ensure that the layout is an identical match to the cell schematic. <br /><br /><strong>28)What is DFT ?</strong> <br /><br />DFT means design for testability. &#39;Design for Test or Testability&#39; - a methodology that ensures a design works properly after manufacturing, which later facilitates the failure analysis and false product/piece detection<br />Other than the functional logic,you need to add some DFT logic in your design.This will help you in testing the chip for manufacturing defects after it come from fab. Scan,MBIST,LBIST,IDDQ testing etc are all part of this. (this is a hot field and with lots of opportunities) <br /><br /><strong>29) There are two major FPGA companies: Xilinx and Altera. Xilinx tends to promote its hard processor cores and Altera tends to promote its soft processor cores. What is the difference between a hard processor core and a soft processor core?</strong> <br /><br />A hard processor core is a pre-designed block that is embedded onto the device. In the Xilinx Virtex II-Pro, some of the logic blocks have been removed, and the space that was used for these logic blocks is used to implement a processor. The Altera Nios, on the other hand, is a design that can be compiled to the normal FPGA logic. <br /><br /><strong>30)What is the significance of contamination delay in sequential circuit timing?</strong> <br /><br />Look at the figure below. tcd is the contamination delay. <br /><br /><img src="http://asic.co.in/Index_files/synthesis_files/contamination_1.gif" alt="" width="400" height="324" align="absMiddle" /> <br /><br />Contamination delay tells you if you meet the hold time of a flip flop. To understand this better please look at the sequential circuit below. <br /><br /><img src="http://asic.co.in/Index_files/synthesis_files/contamination_2.gif" alt="" width="400" height="177" align="absMiddle" /> <br /><br />The contamination delay of the data path in a sequential circuit is critical for the hold time at the flip flop where it is exiting, in this case R2.<br />mathematically, th(R2) &lt;= tcd(R1) + tcd(CL2)<br />Contamination delay is also called tmin and Propagation delay is also called tmax in many data sheets. <br /><br /><strong>31)When are DFT and Formal verification used?</strong> <br /><br />DFT:<br />&middot; manufacturing defects like stuck at &quot;0&quot; or &quot;1&quot;.<br />&middot; test for set of rules followed during the initial design stage.<br /><br />Formal verification:<br />&middot; Verification of the operation of the design, i.e, to see if the design follows spec.<br />&middot; gate netlist == RTL ?<br />&middot; using mathematics and statistical analysis to check for equivalence.<br /><br /><strong>32)What is Synthesis?</strong><br /><br />Synthesis is the stage in the design flow which is concerned with translating your Verilog code into gates - and that&#39;s putting it very simply! First of all, the Verilog must be written in a particular way for the synthesis tool that you are using. Of course, a synthesis tool doesn&#39;t actually produce gates - it will output a netlist of the design that you have synthesised that represents the chip which can be fabricated through an ASIC or FPGA vendor. <br /><br /><strong>33)We need to sample an input or output something at different rates, but I need to vary the rate? What&#39;s a clean way to do this?</strong><br /><br />Many, many problems have this sort of variable rate requirement, yet we are usually constrained with a constant clock frequency. One trick is to implement a digital NCO (Numerically Controlled Oscillator). An NCO is actually very simple and, while it is most naturally understood as hardware, it also can be constructed in software. The NCO, quite simply, is an accumulator where you keep adding a fixed value on every clock (e.g. at a constant clock frequency). When the NCO &quot;wraps&quot;, you sample your input or do your action. By adjusting the value added to the accumulator each clock, you finely tune the AVERAGE frequency of that wrap event. Now - you may have realized that the wrapping event may have lots of jitter on it. True, but you may use the wrap to increment yet another counter where each additional Divide-by-2 bit reduces this jitter. The DDS is a related technique. I have two examples showing both an NCOs and a DDS in my File Archive. This is tricky to grasp at first, but tremendously powerful once you have it in your bag of tricks. NCOs also relate to digital PLLs, Timing Recovery, TDMA and other &quot;variable rate&quot; phenomena <br /></font></p> Tue, 02 Oct 2007 22:04:24 -0000 http://www.isurs.com/modules/newbb/viewtopic.php?topic_id=634&forum=5 http://www.isurs.com/modules/newbb/viewtopic.php?topic_id=527&forum=5 求职生涯::在美国赌城的华人发牌员:看透人生，十赌九输 zt<br /> <font size="3">在凯撒赌场工作的张姓发牌员介绍说，发牌员通常是周薪制，第一年的底薪是每小时4美元，每小时还有约20至30美元的小费，估计一个月的收入为4400美元。工作一年左右的发牌员一年能拿3万到5万美元，在美国属于中等以上收入。 <br /><br />　　7月8日，美国新泽西州州长签署了重开州政府的执行令，大西洋城12家赌场在停业3天后再度开业，这是大西洋城赌场近28年来的首次停业，近万名华人发牌员待业在家。见惯了&ldquo;输赢&rdquo;的他们经过了难忘的3天后，还要继续书写自己的赌城故事。<br /><br />　　<strong>待遇不错，缺乏保障 </strong><br /><br />　　赌博是新泽西州的经济命脉，大西洋城赌场共有5万多名员工，其中亚裔占了20%至25%。由于只要有合法工作资格的移民，不限年龄和学历都可做发牌员。所以，发牌员成为华人移民的首选。另外，赌场的医疗保险等福利齐全，一人在赌场上班，配偶子女就可享受80%的免费医疗，每年还有免费体检和免费配眼镜等优惠。<br /><br /></font><font size="3"><img src="http://news.china.com/zh_cn/history/all/11025807/20070724/images/14239953_392557.jpg" border="1" alt="" width="410" height="269" /><br /><br />一名华人发牌员在大西洋的赌场中发牌</font><br /><br /><font size="3">　　在凯撒赌场工作的张姓发牌员介绍说，发牌员通常是周薪制，第一年的底薪是每小时4美元，每小时还有约20至30美元的小费，估计一个月的收入为4400美元。工作一年左右的发牌员一年能拿3万到5万美元，在美国属于中等以上收入。在海景豪华大赌场做了32年发牌员的曹女士回忆说，30多年前的发牌员每小时工资只有1美元，但每天能得到60美元的小费，一个月收入可达到2000多美元。当时新泽西州电脑工程师的月薪才700美元，2万美元就可买一栋房子。<br /><br />　　尽管薪资不低，这份工作却不稳定。从事发牌工作仅数月的李秀娥告诉记者，现在她最担心的是赌场借故裁员，&ldquo;这一切原本就由不得我们！&rdquo;她苦笑着说。她表示，她之前有几名不错的发牌员，因故被赌场辞退了。当记者问她如果被辞退了有何打算时，李秀娥笑着说，&ldquo;大不了继续端盘子！&rdquo;<br /><br />　　<strong>手脚麻利，吃苦耐劳</strong><br /><br />　　发牌员是美国赌场里最基础的工作，由于华人数学好，干活手脚麻利，吃苦耐劳又好管理，再加上华裔赌客能占到大西洋赌城的30%，因此许多赌场的老板都爱雇佣华人。<br /><br />　　李秀娥告诉记者，这里的许多华裔发牌员都是从纽约来新泽西的，她觉得当发牌员并不难，只要手利索，能达到赌场规定的发牌数就可以了。但她也表示，当发牌员态度很重要，有的客人喝醉了来赌钱，输了钱拿发牌员当出气筒，对客人这些举止都要泰然处之。<br /><br />　　一名华人发牌员在网上论坛里写道，合法经营的美国大赌场并没有电影里那种暴力场面，发牌员都受过严格训练，并经过语言能力、个人背景调查(有无不良记录)和发牌技术等考核，拿到执照后才能上岗。大多数赌场都自己雇人训练发牌员，美国也有专门的发牌员学校，培训8周就能上岗。<br /><br />　　不过，一些华人发牌员也认为，华人的不足之处是英文差，有客人问厕所在哪里，有的华人发牌员竟回答Yes。华人生性保守，不会跟客人聊天，也影响了他们的小费收入。<br /><br />　　<strong>看透人生，十赌九输 </strong><br /><br />　　李秀娥入行时间虽然短，但她体会在赌场工作最重要的是要有平常心。而在赌场工作几十年的曹女士也称，一些华人发牌员长期在赌场上班，下班之后就转换角色，摇身变成了赌客。十赌九输，经不起诱惑就会倾家荡产。<br /><br />　　曹女士说，赌场规定，发牌员下班之后可以玩吃角子老虎机，但不能上赌桌玩&ldquo;21点&rdquo;和&ldquo;百家乐&rdquo;等。可别小看5分钱，玩上瘾也会输得精光。<br /><br />　　曹女士有个江苏来的同事，禁不起诱惑&ldquo;下海&rdquo;了，结果，最后连吃住都负担不起。曹女士想拉这位同事一把，请她到家里来住，并&ldquo;约法三章&rdquo;，工资由曹女士保管。同事先是一口答应，但等到存了4000多美元后，就向曹女士要钱去&ldquo;玩一玩&rdquo;，被曹女士拒绝后马上翻脸。曹女士无奈交出了钱，这位同事早上拿到钱，晚上就输得一分不剩了。</font> Tue, 24 Jul 2007 17:32:09 -0000 http://www.isurs.com/modules/newbb/viewtopic.php?topic_id=527&forum=5 http://www.isurs.com/modules/newbb/viewtopic.php?topic_id=480&forum=5 求职生涯::加拿大俩普通新移民的故事：心态积极 事半功倍<br /> <p><font size="3">中新网7月6日电 对于新移民来说，移民加拿大不仅仅是生活环境、工作环境的改变，更重要的是心理环境的改变。有无数的新移民通过不同的途径在人生道路上做出了一次次选择， 打工、上学、经商、从事专业工作，真正的是七十二行无不精彩。文章以两位普通新移民的经历为例，说明了努力和积极的处事心态对新移民的重要意义。<br /><br /> 　　侯甜甜：主动把握自己的命运<br /><br /> 　　侯甜甜是2006年来多伦多的，因为老公已经来了几年，所以等她来的时候，已经有一个温暖的家在等着她了。<br /><br /> 　　来多伦多之前，侯甜甜在山东青岛一家有名的公司从事货代工作，工作得心应手，收入也相当可观。侯甜甜说，要不是为了追寻爱情，她是不会放弃这一切的，因为放弃自己熟悉的生活圈子、放弃自己熟悉的工作是一件很痛苦的事，但为了爱情，她必须做出选择，于是她来到了多伦多。<br /><br /> 　　刚来的时候，她真的很难以适应加拿大的新生活。<br /><br /> 　　侯甜甜至今还不太会做饭，对她来说，做饭是个太困难的事情。侯甜甜是独生女，从小到大妈妈一直呵护着她，读书、读书，还是读书，在妈妈的眼里只要好好读书，其他的什么都不要管。结果是至今她还不会做饭，侯甜甜有时候慨叹，妈妈的宠爱从某种程度上说害了她。<br /><br /> 　　因为不会做饭，她每天眼睁睁地等着老公下班，然后做两个人的饭。侯甜甜心如刀绞，工作没着落，连饭都做不了，自己不成了废人吗？她十分心疼老公，于是她开始学习做饭。对别人来说做饭是个太容易的事，但对侯甜甜来说，做饭比学英语可难多了。<br /><br /> 　　侯甜甜至今还记得来多伦多后学习蒸米饭的事，她笑着说从吃夹生饭开始，如今她已经能蒸出很好吃的白米饭了。开始学炒菜，她从下午两点就开始做晚饭，到 老公回家时已是六点，而她不过只做了两个普普通通的菜而已。切土豆丝，她已经记不起切过多少次手指了。侯甜甜说，现在她做的饭还属于初级水平，但她很满意 自己的进步，老公也给了她极大的鼓励。<br /><br /> 　　适应了生活之后，侯甜甜意识到英语是她的一个障碍。尽管在国内时她工作中经常要使用英语书写公文，但口语很少用，真的到加拿大后要面对西人时，她的自信一下子没有了。<br /><br /> 　　侯甜甜参加了一个移民服务中心举办的找工讲座，简历发了上百份，面试的机会寥寥无几。一边学英语，一边关注工作信息，一边做志愿者，这个时候，移民服 务中心提供给她一个信息，一个由政府资助的培训项目，不仅免学费，还资助生活费每月1000加元。这毫无疑问是个绝好的学习技能和了解加拿大经商的机会， 然而20个人的培训班有300多人申请，我行吗？不试试怎么知道？就这样侯甜甜递交了申请。按照要求直接邮寄就可以，但侯甜甜选择了直接去面递简历，她知 道人怕见面的这个道理。<br /><br /> 　　原本通知一个月告知是否录取，然而一个月过去没有丝毫消息，想家心切的她预定了回国的机票。侯甜甜有些不甘心，便主动打电话去询问，仍然没有消息。过 了几天又去问，人家已经很熟悉她了，甚至可以和她开开玩笑。在面试前曾有一个老师做过辅导，仅仅一天的时间，老师上课前公布了自己的电邮地址，上课结束后 问大家，谁记得他的电邮地址，侯甜甜是全班唯一一个能完整说出来的，这给老师留下了深刻的印象。侯甜甜说，当时她是班里唯一的华人，也是英语最差的一个， 可能是她的执着和坚定打动了老师，最后她连过3关面试被录取了。<br /><br /> 　　侯甜甜接受的培训就是如何在加拿大开展生意，于是她边学边练。<br /><br /> 　　在国内时侯甜甜从事货代业务，于是她先从自己熟悉的领域入手。她应聘到一家公司，干得很卖力气，老板也很赏识她。然而她发现，这个老板使用了一些非正 常的经营手段，这让侯甜甜很气愤，也很不解，在中国也不能这样做生意啊。侯甜甜很快离开了这家公司，没多久，这家公司就倒闭了。侯甜甜想，与其担惊受怕为 别人干，为什么不自己去做呢？<br /><br /> 　　侯甜甜的想法得到了老公的支持，不久她就注册了自己的公司，开始了自己的创业之旅。如今侯甜甜的货代业务已经运作半年多了，公司的业务也逐渐有了起色。许多过去的老客户又联系上了，新的朋友、新的客户在逐渐增加，重要的是，她又找回了自信。<br /><br /> 　　侯甜甜回国一趟，一个偶然的机会，她发现在中国颇受欢迎的防幅射服装在加拿大居然还是一个空白，而她的身边就有朋友是孕妇或者整天与电脑打交道的人， 她们都需要这样的保健产品。侯甜甜抱着试试看的想法，带了几件样品回来，结果全被朋友们瓜分了。于是她又空运了一些样品过来，并准备将防幅射服装在西人中 推广。目前侯甜甜正在多方咨询，准备申请防幅射服装的产品检测，未来她还准备生产自己的品牌服装。 <br /><br /> 　Molly：发现下一个风景<br /><br /> 　　Molly似乎不知道什么叫发愁，你每次见到她都会听到她的笑声，她的爽朗也感染了身边的每一个朋友。<br /><br /> 　　Molly几年前从深圳来加拿大。在深圳她先在金融系统工作，后进入一家公司从事留学生中介服务。Molly说，那些年留学热，仅深圳每年就要输出留 学生1000人左右，生意很火爆。那时中国一直是加拿大最大的留学生来源国，1999年鼎盛时期达到5万人，最近几年有所回落，现在韩国成了加拿大最大的 留学生来源国了。<br /><br /> 　　Molly来加拿大之后，发现留学生还需要许多后续服务，比如接机、住宿、买车、办保险等等。于是他开始从为留学生购买保险的业务做起，考取了保险执照，开始了她的保险生意。<br /><br /> 　　2003年，Molly进入一家保险代理公司。这年发生了一个意外，这家保险代理公司的老板，一个年仅38岁的华裔老板突然因中风去世，公司业务一下 子陷入混乱之中，不久就清盘了。而此刻Molly代理的许多留学生的保险出现了一些问题，虽然问题总算解决了，但这事给Molly留下了很深的印象，这样 做生意风险太大了，一旦代理公司出现问题，她的客户就要面临遭受损失的风险。于是Molly注册了自己的保险产品经纪公司，这样她就可以突破一个瓶颈，可 以挑选更多有实力的保险公司和保险产品。以保证客户安全，降低风险。<br /><br /> 　　成立了自己的保险产品经纪公司后，新的问题又来了。由于保险这一行竞争很激烈，Molly发现公司里保险经纪的收入很低，有的人一年只能赚一两万块 钱，英语差，没有本地经验，如何帮助他们？能不能通过上学解决长远问题？围绕这个问题Molly四处打探，终于找到了一个重要信息，原来加拿大政府有上学 资助，只要是新移民，符合一定的条件，都可以申请。不仅可以申请到学费无息贷款，还可以拿到部分生活补贴。Molly很纳闷，这么好的资源，为什么没人利 用呢？她把这个消息告诉了许多自己的朋友，大家都说有这等好事，从没听说过。Molly的一个朋友王先生，英语不太好，在Molly的帮助下成功申请到了 19000元，学习商业管理10个月的课程，其中1万为学费，另9千为生活补贴，而且毕业后5年之内只需还1万学费的70%。Molly的朋友徐女士，在 国内是医生，她选择了一门9个月的药剂学课程，学费9600元，但她成功申请到了24800元，生活补贴足以支持她全家的生活。<br /><br /></font></p><div align="center"><font size="3"><font size="4"> 　　</font></font><font size="4"> <strong>加拿大俩普通新移民的故事：心态积极 事半功倍</strong></font></div><p>&nbsp;</p><p align="center">&nbsp;(<a href="http://members.wenxuecity.com/profile.php?cid=1tDQws34" target="blank">中新网</a>)</p><p><font size="3">从去年开始，Molly已经成功帮助了7位朋友申请到了政府助学贷款。<br /><br /> 　　有一天，她的一个客户打电话给她，因为两个孩子小，老公上夜班，而她那天有一件很重要的事要做，希望Molly能帮忙照看孩子。虽然Molly没能帮 上这个忙，但她发现了问题，这个家庭需要保姆。于是Molly与客户进行了沟通，表示可以为她找到合格的保姆，问她需要不需要？客户当即表示了强烈的需要 保姆的愿望。<br /><br /> 　　Molly经过调查，发现需要保姆的家庭有很多，而合格的华人保姆很难寻找，这就是商机。Molly很快与国内一家专业公司达成协议，由对方负责挑选 合格的保姆人选并进行专业培训，由她负责办理签证和雇主寻找。从去年9月开始，Molly已经成功为7位保姆办理了签证，目前还有几人的申请在处理之中。 Molly说，为客户提供服务，让客户感觉到你是在为她着想，客户心里一清二楚，而我在为客户提供服务的同时总会有新的发现。<br /><br /> 　　与人接触越多，Molly发现其实人们需要的服务永无止境。目前Molly和几个朋友一起谋划建立一个新移民互助平台，她希望通过这个平台把更多有益 的信息提供给新移民，为他们安家立业少走弯路做点实实在在的事情。Molly说论做生意她远没有达到成功的境界，还只是起步阶段，但她认为，人的真正成功 更多来自于精神上的快乐，在发现中寻找机会，有做不完的事情，也就能发现无穷的快乐</font> </p> Fri, 06 Jul 2007 17:18:18 -0000 http://www.isurs.com/modules/newbb/viewtopic.php?topic_id=480&forum=5